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  •   基于CPLD的三相電源保護(hù)裝置的軟件設(shè)計(jì)

    目 錄第一章 緒論 ………………………………………………………………1 1.1研究背景及意義 1 1.2本文的主要工作 …………………………………………………1第二章 設(shè)計(jì)內(nèi)容介紹 …………………………………………………..32.1 CPLD器件和EDA設(shè)計(jì)技術(shù) 32.2 “CPLD＋單片機(jī)體系結(jié)構(gòu)”的特點(diǎn) 42.3 系統(tǒng)組成原理 62.3.1..

         

  •   基于FPGA的多波形信號(hào)發(fā)生器的軟件設(shè)計(jì)

    目 錄 第一章 緒論……………………………………………………………………………………1 1.1 研究的內(nèi)容與意義………………………………………………………………………1 1.2 國(guó)內(nèi)外發(fā)展概況……………………………………………………………………………1 1.3 本文主要內(nèi)容……………………………………………………..

         

  •   基于FPGA的多波形信號(hào)發(fā)生器的硬件設(shè)計(jì)

    目 錄第一章 緒論 - 1 -1.1 研究意義 - 1 -1.2國(guó)內(nèi)外發(fā)展動(dòng)態(tài) - 2 -1.3 本次設(shè)計(jì)主要工作 - 3 -第二章 多波形發(fā)生器的總體設(shè)計(jì) - 4 -2.1 總體方案討論 - 4 -2.2 多波形發(fā)生器系統(tǒng)框架 - 5 -2.3 多波形發(fā)生器工作原理 - 6 -第三章 硬件電路設(shè)計(jì) - 8 -3.1 FPGA電路組成 - 8 -3.2 DAC0832接口電路設(shè)計(jì) - 16 -3.3 開關(guān)..

         

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