低功率實時小波codec 電路的設(shè)計.doc
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低功率實時小波codec 電路的設(shè)計,低功率實時小波codec 電路的設(shè)計本文共22頁7883字 附英文翻譯摘要：本文提出可能壓縮和重建4:2:2 顏色vga視頻圖像使用二維dwt 編碼電路的體系結(jié)構(gòu)和設(shè)計。為實時操作和低功率消耗, 我們修改傳統(tǒng)mallat 的分量編制程序方法減少在二維dwt上相當(dāng)數(shù)量計算。運用修改過的方法, 二維dwt 可能由二套一維d...
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低功率實時小波CODEC 電路的設(shè)計
本文共22頁 7883字 附英文翻譯
摘要：本文提出可能壓縮和重建4:2:2 顏色VGA視頻圖像使用二維DWT 編碼電路的體系結(jié)構(gòu)和設(shè)計。為實時操作和低功率消耗, 我們修改傳統(tǒng)Mallat 的分量編制程序方法減少在二維DWT上相當(dāng)數(shù)量計算。運用修改過的方法, 二維DWT 可能由二套一維DWT 的操作執(zhí)行，不管分解層次的數(shù)量。我們采取舒張的列陣體系設(shè)計電路來實現(xiàn)我們的方法。我們的低功率實時編碼電路設(shè)計了采用Verilog HDL 和制造了作為一塊VLSI 芯片使用0.35毫米3.3 V CMOS 標準制作方法。我們做了一個簡單的DVR 系統(tǒng)使用我們的編碼芯片從硬盤存儲，檢索視頻圖象數(shù)據(jù)和監(jiān)視實時操作系統(tǒng)。
關(guān)鍵字：編碼；分量；存儲；分解
參考文獻
[1] S.G. Mallat, IEEE Trans. Pattern Anal. Mach. Intel. 11 (7) (1989) 674.
[2] M.J. Shensa, IEEE Trans. Signal Process. 40 (10) (1992) 2464.
[3] A. Grzeszczak, M.K. Mandal, S. Panchanathan, T. Yeap, IEEE Trans. VLSI Syst. 4 (4) (1996) 421.
[4] I. Daubechies, Commun. Pure Appl. Math. 41(1 988) 909.
本文共22頁 7883字 附英文翻譯
摘要：本文提出可能壓縮和重建4:2:2 顏色VGA視頻圖像使用二維DWT 編碼電路的體系結(jié)構(gòu)和設(shè)計。為實時操作和低功率消耗, 我們修改傳統(tǒng)Mallat 的分量編制程序方法減少在二維DWT上相當(dāng)數(shù)量計算。運用修改過的方法, 二維DWT 可能由二套一維DWT 的操作執(zhí)行，不管分解層次的數(shù)量。我們采取舒張的列陣體系設(shè)計電路來實現(xiàn)我們的方法。我們的低功率實時編碼電路設(shè)計了采用Verilog HDL 和制造了作為一塊VLSI 芯片使用0.35毫米3.3 V CMOS 標準制作方法。我們做了一個簡單的DVR 系統(tǒng)使用我們的編碼芯片從硬盤存儲，檢索視頻圖象數(shù)據(jù)和監(jiān)視實時操作系統(tǒng)。
關(guān)鍵字：編碼；分量；存儲；分解
參考文獻
[1] S.G. Mallat, IEEE Trans. Pattern Anal. Mach. Intel. 11 (7) (1989) 674.
[2] M.J. Shensa, IEEE Trans. Signal Process. 40 (10) (1992) 2464.
[3] A. Grzeszczak, M.K. Mandal, S. Panchanathan, T. Yeap, IEEE Trans. VLSI Syst. 4 (4) (1996) 421.
[4] I. Daubechies, Commun. Pure Appl. Math. 41(1 988) 909.
