Cadence 中文使用參考
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摘要
作為流行的EDA工具之一，Cadence一直以來都受到了廣大EDA工程師的青睞。然而Cadence的使用之繁瑣，又給廣大初學(xué)者帶來了不少麻煩。作為一位過來人，本人對此深有體會。本著為初學(xué)者拋磚引玉的目的，本人特意編寫了這本小冊子，將自己數(shù)年來使用Cadence的經(jīng)驗(yàn)加以總結(jié)，但愿會對各位同行有所幫助。本冊子的本意在于為初學(xué)者指路，故不會對個別工具進(jìn)行很詳細(xì)的介紹，只是對初學(xué)者可能經(jīng)常使用的一些工具加以粗略的介紹。其中可能還請各位同行加以指正。



目錄
概述 1
1.1 Cadence概述 1
1.2 ASIC設(shè)計流程 1
第一章 Cadence 使用基礎(chǔ) 5
2.1 Cadence 軟件的環(huán)境設(shè)置 5
2.2 Cadence軟件的啟動方法 10
2.3庫文件的管理 12
2.4文件格式的轉(zhuǎn)化 13
2.5 怎樣使用在線幫助 13
2.6 本手冊的組成 14
第二章 Verilog-XL 的介紹 15
3. 1 環(huán)境設(shè)置 15
3.2 Verilog-XL的啟動 15
3.3 Verilog－XL的界面 17
3.4 Verilog-XL的使用示例 18
3.5 Verilog-XL的有關(guān)幫助文件 19
第四章 電路圖設(shè)計及電路模擬 21
4.1 電路圖設(shè)計工具Composer 21
4.1.1 設(shè)置 21
4.1.2 啟動 22
4.1.3 用戶界面及使用方法 22
4.1.4 使用示例 24
4.1.5 相關(guān)在線幫助文檔 24
4.2 電路模擬工具Analog Artist 24
4.2.1 設(shè)置 24
4.2.2 啟動 25
4.2.3 用戶界面及使用方法 25
4.2.5 相關(guān)在線幫助文檔 25
第五章 自動布局布線 27
5.1 Cadence中的自動布局布線流程 27
5.2 用AutoAbgen進(jìn)行自動布局布線庫設(shè)計 28
第六章 版圖設(shè)計及其驗(yàn)證 30
6.1 版圖設(shè)計大師Virtuoso Layout Editor 30
6.1.1 設(shè)置 30
6.1.2 啟動 30
6.1.3 用戶界面及使用方法 31
6.1.4 使用示例 31
6.1.5 相關(guān)在線幫助文檔 32
6.2 版圖驗(yàn)證工具Dracula 32
6.2.1 Dracula使用介紹 32
6.2.2 相關(guān)在線幫助文檔 33
第七章 skill語言程序設(shè)計 34
7.1 skill語言概述 34
7.2 skill語言的基本語法 34
7.3 Skill語言的編程環(huán)境 34
7.4面向工具的skill語言編程 35
附錄1 技術(shù)文件及顯示文件示例 60
附錄2 Verilog-XL實(shí)例文件 72
1．Test_memory.v 72
2．SRAM256X8.v 73
3．ram_sy1s_8052 79
4．TSMC庫文件 84
附錄3 Dracula 命令文件 359