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eda應(yīng)用設(shè)計(jì)研究-以數(shù)字鐘和下載線為例.doc

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eda應(yīng)用設(shè)計(jì)研究-以數(shù)字鐘和下載線為例,3.1萬字48頁鬧含設(shè)計(jì)圖利用eda工具,電子設(shè)計(jì)師可以從概念、算法、協(xié)議等開始設(shè)計(jì)電子系統(tǒng),大量工作可以通過計(jì)算機(jī)完成,并可以將電子產(chǎn)品從電路設(shè)計(jì)、性能分析到設(shè)計(jì)出ic版圖或pcb版圖的整個(gè)過程在計(jì)算機(jī)上自動(dòng)處理完成。本文首先介紹了eda技術(shù)的發(fā)展概況,fpga / cpld的結(jié)構(gòu)和工作原理,開發(fā)的流程、優(yōu)缺點(diǎn),常用...
編號(hào):99-4033大小:2.44M
分類: 論文>通信/電子論文

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此文檔由會(huì)員 大喜宙 發(fā)布

3.1萬字 48頁 鬧含設(shè)計(jì)圖
利用EDA工具,電子設(shè)計(jì)師可以從概念、算法、協(xié)議等開始設(shè)計(jì)電子系統(tǒng),大量工作可以通過計(jì)算機(jī)完成,并可以將電子產(chǎn)品從電路設(shè)計(jì)、性能分析到設(shè)計(jì)出IC版圖或PCB版圖的整個(gè)過程在計(jì)算機(jī)上自動(dòng)處理完成。本文首先介紹了EDA技術(shù)的發(fā)展概況,F(xiàn)PGA / CPLD的結(jié)構(gòu)和工作原理,開發(fā)的流程、優(yōu)缺點(diǎn),常用的EDA開發(fā)工具,VHDL語言的歷史、開發(fā)步驟及其優(yōu)點(diǎn),以及芯片的幾種配置方式:然后通過智能搶答器這些具體實(shí)例介紹了FPGA的三類應(yīng)用:簡單邏輯應(yīng)用、在控制上的應(yīng)用和在數(shù)字信號(hào)處理上的應(yīng)用,并利用VHDL語言,采用自上而下的設(shè)計(jì)方法,完成了各個(gè)系統(tǒng)的設(shè)計(jì)工作;最后介紹了EDA技術(shù)的前沿發(fā)展趨勢。

關(guān)鍵詞:電子設(shè)計(jì)自動(dòng)化(EDA );VHDL;下載線


ABSTRACT


This article first introduced the EDA technology development survey, FPGA/ CPLD structure and principle of work, The development flow, the good and bad points, the commonly used EDA development kit, the VHDL language history, the development step and its the merit, then introduced the FPGA three kind of applications through intelligent viing to answer first these concrete examples: The simple logical application, in the control application and in the digital signal processing application, and using the VHDL language, uses the top-down design method, has completed each system design work; Finally briefed the EDA technology front development tendency.

Key word Electronic design automation (EDA) ;VHDL; downloading line


目 錄

1 緒論
2 EDA技術(shù)的基礎(chǔ)知識(shí)
3 VHDL硬件描述語言1

4 數(shù)字鐘的設(shè)
5 下載線
6 設(shè)計(jì)總結(jié)及EDA技術(shù)前沿發(fā)展趨勢
6.1 設(shè)計(jì)總結(jié)
6.2 EDA技術(shù)的前沿發(fā)展趨勢

參考文獻(xiàn)
致謝
附錄